Cerrado

Descifrado verilog

Job Description:

A partir del codigo de cisfrado, que facilito. Implementar el codigo para descifrado.

Para ello se Implementará el algoritmo de descifrado y comprobarás su funcionamiento usando el mensaje cifrado como entrada y la clave operativa (MSBF). Si la simulación es correcta, el resultado será un bloque de 64 bits a cero (u ocho bytes a cero).

A continuación, descrifrarás el mensaje cifrado que faciltaré con la clave operativa asociada. Y colocarás el mensaje en claro en la caja de texto de la tarea.

Se proporcionará todos los archivos, claves en privado.

Se necesita para el día 2 de Noviembre, es una tarea de estudios, fácil. El tiempo estimado de trabajo es 30 min porque el codigo de cisfrado lo tengo, solo es modificarlo para el descifrado

Habilidades: Verilog / VHDL, Ingeniería eléctrica, Mathlab y Mathematica, Electrónica, FPGA

Sobre el cliente:
( 2 comentarios ) Badajoz, Spain

Nº del proyecto: #31985099

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huzaifarizwan995

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Miguelbucio

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